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Titlebook: Verbessertes virtuelles Prototyping; Mit RISC-V-Fallstudi Vladimir Herdt,Daniel Große,Rolf Drechsler Book 2022 Der/die Herausgeber bzw. der

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发表于 2025-3-21 19:32:25 | 显示全部楼层 |阅读模式
书目名称Verbessertes virtuelles Prototyping
副标题Mit RISC-V-Fallstudi
编辑Vladimir Herdt,Daniel Große,Rolf Drechsler
视频video
概述Ermöglicht die Verbesserung und Test aller wichtigen Aspekte eines Virtual Prototype.Enthält Korrespondenzanalysen zur Nutzung von Informationen zwischen verschiedenen Abstraktionsebenen.Verwendet meh
图书封面Titlebook: Verbessertes virtuelles Prototyping; Mit RISC-V-Fallstudi Vladimir Herdt,Daniel Große,Rolf Drechsler Book 2022 Der/die Herausgeber bzw. der
描述.Dieses Buch stellt eine umfassende Reihe von Techniken vor, die alle wichtigen Aspekte eines modernen Virtual Prototype (VP)-basierten Entwurfsablaufs verbessern. Die Autoren legen den Schwerpunkt auf automatisierte formale Verifikationsmethoden sowie auf fortgeschrittene, abdeckungsgeleitete Analyse- und Testtechniken, die auf SystemC-basierte VP und die zugehörige Software (SW) zugeschnitten sind. Die Abdeckung umfasst auch VP-Modellierungstechniken, die sowohl funktionale als auch nicht-funktionale Aspekte behandeln, und beschreibt zudem Korrespondenzanalysen zwischen der Hardware- und VP-Ebene, um die auf verschiedenen Abstraktionsebenen verfügbaren Informationen zu nutzen. Alle Ansätze werden ausführlich diskutiert und anhand mehrerer Experimente evaluiert, um ihre Effektivität bei der Verbesserung des VP-basierten Entwurfsablaufs zu demonstrieren. Darüber hinaus legt das Buch einen besonderen Schwerpunkt auf den modernen RISC-V ISA, mit mehreren Fallstudien, die sowohl Aspekteder Modellierung als auch der VP- und SW-Verifikation abdecken..
出版日期Book 2022
关键词Virtuelle Prototypen auf der Ebene elektronischer Systeme; SystemC-basierte virtuelle Prototypen; Form
版次1
doihttps://doi.org/10.1007/978-3-031-18174-0
isbn_ebook978-3-031-18174-0
copyrightDer/die Herausgeber bzw. der/die Autor(en), exklusiv lizenziert an Springer Nature Switzerland AG 20
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发表于 2025-3-22 00:02:24 | 显示全部楼层
,Präliminarien,er symbolischen Ausführung vorgestellt. Beides sind sehr effektive Techniken für das Testen und Verifizieren von Software und dienen als Grundlage für mehrere in diesem Buch entwickelte Verifikationsansätze.
发表于 2025-3-22 01:04:06 | 显示全部楼层
,Einführung,. Ein VP ist im Wesentlichen ein ausführbares abstraktes Modell der gesamten Hardware (HW) Plattform und wird überwiegend in SystemC TLM (Transaction Level Modeling) erstellt. Im Gegensatz zu einem traditionellen Entwurfsablauf, bei dem zuerst die HW und dann die Software (SW) entwickelt wird, ermög
发表于 2025-3-22 06:31:01 | 显示全部楼层
发表于 2025-3-22 11:51:30 | 显示全部楼层
发表于 2025-3-22 16:52:58 | 显示全部楼层
,Formale Verifikation von SystemC-basierten Entwürfen durch symbolische Simulation,nsfluss von virtuellen Prototypen (VPs) zu verbessern. Formale Verifikationsmethoden können die Korrektheit eines SystemC-Entwurfs in Bezug auf eine Reihe von Eigenschaften beweisen. Die formale Verifikation von SystemC-Entwürfen stellt jedoch eine große Herausforderung dar, da sie alle möglichen Ei
发表于 2025-3-22 20:55:33 | 显示全部楼层
发表于 2025-3-23 01:11:27 | 显示全部楼层
发表于 2025-3-23 02:13:33 | 显示全部楼层
Validierung von Firmware-basiertem Power Management mit virtuellen Prototypen,ingebettete Systeme. Power-Management-Strategien (PM) können einen großen Beitrag zur allgemeinen Energieeinsparung leisten, indem sie ungenutzte Komponenten in einen stromsparenden Zustand versetzen und sie auf intelligente Art und Weise wieder aufwecken. Aufgrund ihrer Benutzerfreundlichkeit und F
发表于 2025-3-23 05:35:56 | 显示全部楼层
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