strdulate
发表于 2025-3-25 03:57:15
http://reply.papertrans.cn/39/3801/380092/380092_21.png
accordance
发表于 2025-3-25 08:33:57
Partitionierungsschemata für Rechnerstrukturenrungsschemata miteinander verglichen und auf ihre Brauchbarkeit als Blockstruktur für Hardwarebeschreibungssprachen untersucht. Es wird dann ein verallgemeinertes Schema vorgeschlagen, das die Beschreibung von konventionellen Architekturen ebenso wie die Beschreibung von Mehrprozessor-Systemen und VLSI-Strukturen unterstützt.
CLASH
发表于 2025-3-25 11:54:47
http://reply.papertrans.cn/39/3801/380092/380092_23.png
biopsy
发表于 2025-3-25 17:55:25
https://doi.org/10.1007/978-3-662-31520-0 Defekttoleranz wird eine zweistufige Hierarchie mit unterschiedlichen Rekonfigurierungskonzepten verwendet. Anwendungen eines solchen SIMD-Arrays ergeben sich in der Echtzeitbildverarbeitung und bei assoziativen Prozessoren.
Chemotherapy
发表于 2025-3-25 20:56:53
https://doi.org/10.1007/978-3-662-42314-1unvollständigen Prüfpfades die Testmusterbestimmung nicht für ein beliebiges synchrones Schaltwerk durchzuführen ist, sondern auf den einfacheren Test von Schaltwerken mit Pipelinestruktur abgebildet werden kann.
粉笔
发表于 2025-3-26 04:08:49
http://reply.papertrans.cn/39/3801/380092/380092_26.png
阻止
发表于 2025-3-26 05:41:52
,Klärung des Tragfähigkeitsbegriffes,estbarer Module. Testarchitekturen liefern Modelle für eine automatische Testvorbereitung. Im vorliegenden Aufsatz wird eine neue Strategie für den Entwurf von Testarchitekturen und ein konzeptioneller Ansatz für eine darauf abgestimmte Testvorbereitung vorgestellt.
压倒
发表于 2025-3-26 08:53:47
https://doi.org/10.1007/978-3-662-31519-4bungsniveau auf, das der Gatterebene entspricht. In dieser Arbeit wird ein Algorithmus zum Testdatentransport auf Abstraktionsebenen oberhalb der Gatterebene vorgestellt. An einem Beispiel wird demonstriert, wie der Algorithmus im Rahmen einer hierarchischen Testvorbereitung für sequentielle Schaltungen effizient eingesetzt werden kann.
amorphous
发表于 2025-3-26 16:24:42
http://reply.papertrans.cn/39/3801/380092/380092_29.png
兵团
发表于 2025-3-26 18:06:13
Ein Ansatz zur hierarchischen Testvorbereitung für sequentielle Schaltungenbungsniveau auf, das der Gatterebene entspricht. In dieser Arbeit wird ein Algorithmus zum Testdatentransport auf Abstraktionsebenen oberhalb der Gatterebene vorgestellt. An einem Beispiel wird demonstriert, wie der Algorithmus im Rahmen einer hierarchischen Testvorbereitung für sequentielle Schaltungen effizient eingesetzt werden kann.